基于FPGA的高速并行Viterbi译码器的设计与实现
《电子技术应用》2007年第1期
童 琦，何洪路，吴明森
摘要： 针对319卷积编码，提出一种Viterbi译码器的FPGA实现方案。该方案兼顾了资源消耗和译码效率，通过有效的时钟和存储介质复用，实现了高速并行的译码功能，并利用Verilog语言在Xilinx ISE 6．2中进行了建模仿真和综合实现。
Abstract：
Key words :
摘 要： 針對319卷積編碼，提出一種Viterbi譯碼" title="Viterbi譯碼">Viterbi譯碼器的FPGA實現(xiàn)方案。該方案兼顧了資源消耗和譯碼效率，通過有效的時鐘和存儲介質(zhì)復用，實現(xiàn)了高速并行的譯碼功能，并利用Verilog語言在Xilinx ISE" title="ISE">ISE 6．2中進行了建模仿真和綜合實現(xiàn)。
關鍵詞： Viterbi譯碼 路徑值" title="路徑值">路徑值 回溯" title="回溯">回溯
基于FPGA的高速并行Viterbi譯碼器的設計與實現(xiàn).pdf
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