Altera啟動亞太區(qū)SOPC World 2008?

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2008年9月8號，北京——?

內(nèi)容：?

Altera公司(NASDAQ: ALTR)今天公布了其亞太區(qū)年度SOPC World大會的時間和地點。大會將于2008年10月在印度和中國的5個城市舉辦。

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大會包括技術(shù)研討和展覽兩部分，系統(tǒng)設(shè)計人員" title="設(shè)計人員">設(shè)計人員通過此次大會來將了解到怎樣降低系統(tǒng)成本，并滿足嚴格的功耗預(yù)算要求，提高效能。在技術(shù)研討會上，Altera及其合作伙伴將為出席人員介紹最先進的高功效可編程器件以及高效能開發(fā)工具等。

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誰應(yīng)該參加：?

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關(guān)注以高性價比迅速引入新功能和特性，并提高性能" title="高性能">高性能和效能，降低功耗" title="降低功耗">降低功耗的系統(tǒng)設(shè)計人員。

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時間和地點：?

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主題演講人：?

Jordan Plofsky?

Altera市場高級副總裁?

議程和技術(shù)研討:?

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上午時段?

Power Down, Speed Up?

當(dāng)產(chǎn)品及時面市非常關(guān)鍵、ASIC的風(fēng)險太大或者開發(fā)成本過高時，FPGA一直是設(shè)計工程師首選的芯片解決方案，而且也是最便捷的方案。在決定使用FPGA或者ASIC和ASSP替代方案時需要綜合考慮性能和功耗?，F(xiàn)在，在很多方面已經(jīng)不需要對此進行權(quán)衡了。FPGA的功能和性能一直在大幅度增長，而相同功能下的功耗卻在顯著降低。您可以了解到FPGA以及FPGA設(shè)計工具的發(fā)展進步是怎樣幫助設(shè)計人員通過硬件加速，以盡可能低的功耗來實現(xiàn)無與倫比的性能的。?

Altera產(chǎn)品組合面向更高的性能和更低的功耗?

十年前，Altera認識到在所有半導(dǎo)體設(shè)計中，功耗將很快成為最重要的因素。從手持式到大規(guī)?；A(chǔ)應(yīng)用，功耗影響了所有最終產(chǎn)品的成本、性能、可靠性和使用壽命。為解決這一挑戰(zhàn)，Altera進行了長期投入，重點研究工藝進展、創(chuàng)新的功耗管理技術(shù)和功耗優(yōu)化設(shè)計工具，降低CPLD、FPGA和ASIC產(chǎn)品組合的功耗。所有這些都結(jié)合創(chuàng)新來實現(xiàn)，以提高器件性能。結(jié)果是推出了全面的器件產(chǎn)品組合，幫助您降低功耗，加速設(shè)計。 ?

下午時段?

主題1?

采用40-nm FPGA使SoC集成邁上新臺階?

FPGA以其內(nèi)在的靈活性和產(chǎn)品及時面市優(yōu)勢而成為芯片系統(tǒng)(SoC)集成的理想平臺。Altera的40-nm定制邏輯組合包括新的Stratix??IV FPGA和HardCopy??IV ASIC，在密度、性能、特性和接口帶寬上都具有一定的優(yōu)勢，使SoC集成邁上了新臺階。 ?

在Altera FPGA設(shè)計中，使用Aldec Active-HDL混合語言仿真的前沿驗證技術(shù)
－ Aldec?

此次研討會將展示最新的Aldec驗證技術(shù)" title="驗證技術(shù)">驗證技術(shù)，幫助您以更高的水平針對高性能/大容量Altera FPGA器件來驗證復(fù)雜的設(shè)計。研討會將介紹前沿的驗證技術(shù)，例如基于聲明的驗證、功能覆蓋、仿真優(yōu)化和高級調(diào)試技術(shù)等，這些技術(shù)有助于對Altera FPGA進行更精確和更全面的驗證。 ?

采用MathWork的Simulink和Altera的DSP Builder進行通信系統(tǒng)基于模型的設(shè)計；WiMAX設(shè)計實例
－ The MathWorks ?

要在便攜式應(yīng)用設(shè)計" title="應(yīng)用設(shè)計">應(yīng)用設(shè)計中獲得成功，您需要發(fā)揮所有的潛在優(yōu)勢。CPLD能夠提供這樣的優(yōu)勢——它是迅速實現(xiàn)定制商用芯片組的低價格、低風(fēng)險途徑。此外，CPLD還是昂貴的ASIC開發(fā)的快速替代方案。它非常適合在混合電壓環(huán)境中進行電壓電平轉(zhuǎn)換，以及通用I/O引腳擴展，不同接口協(xié)議之間的橋接等。 ?

在該演講中，看看便攜式應(yīng)用設(shè)計人員怎樣使用CPLD來迅速開發(fā)具有競爭力的前沿產(chǎn)品，并了解怎樣使用Altera的CPLD來加速實現(xiàn)您的新一代便攜式應(yīng)用設(shè)計。?

主題2?

使用Altera的嵌入式組合解決方案來提高性能、降低功耗?

當(dāng)今嵌入式處理設(shè)計人員面臨一個難題——最終應(yīng)用需要提高性能，而能源問題則要求降低功耗。要達到性能和功耗的平衡，總是需要進行折衷考慮，要同時考慮設(shè)計、系統(tǒng)體系結(jié)構(gòu)、組件級性能和功耗等……直到現(xiàn)在，這種情況才有所改變。在此次技術(shù)研討期間，通過演講和現(xiàn)場展示，您將了解Altera全面的器件、IP、軟件、參考設(shè)計和帶有實例的開發(fā)套件等嵌入式組合解決方案怎樣幫助您提高設(shè)計性能“與”降低功耗。 ?

使用Altera的CPLD迅速開發(fā)您的便攜式設(shè)計 ?

CPLD在成功實現(xiàn)便攜式應(yīng)用設(shè)計上具有很大的優(yōu)勢——是迅速實現(xiàn)定制商用芯片組的低價格、低風(fēng)險途徑。此外，CPLD非常適合在混合電壓環(huán)境中進行電壓電平轉(zhuǎn)換，以及通用I/O引腳擴展，不同接口協(xié)議之間的橋接等。 ?

在該演講中，您將看到便攜式應(yīng)用設(shè)計人員怎樣使用CPLD來迅速開發(fā)具有競爭力的前沿產(chǎn)品，了解怎樣使用Altera的CPLD來加速實現(xiàn)您的新一代便攜式應(yīng)用設(shè)計。 ?

采用Altera FPGA開發(fā)低成本控制網(wǎng)絡(luò)
－ Echelon?

Echelon公司的LonWorks? 平臺與Altera Nios? II CPU內(nèi)核和Cyclone? II FPGA及Cyclone III FPGA相結(jié)合，在消費類、商用和工業(yè)應(yīng)用中實現(xiàn)了新一代綠色節(jié)能產(chǎn)品。Altera客戶使用Power Line Smart收發(fā)器開發(fā)消費類家電應(yīng)用以及使用Free Topology Smart收發(fā)器開發(fā)復(fù)雜系統(tǒng)控制器和區(qū)域控制器時，Echelon為其提供免費的接口軟件。開發(fā)人員可以針對自己的應(yīng)用來自由選擇軟核處理器和外設(shè)的最佳組合。?

關(guān)于SOPC World 2008的詳細信息，以及怎樣進行注冊，請訪問:?

www.altera.com.cn/sopc 。?

Altera簡介?

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Altera^?的可編程解決方案幫助系統(tǒng)和半導(dǎo)體公司快速高效地實現(xiàn)創(chuàng)新，突出產(chǎn)品優(yōu)勢，贏得市場競爭。請訪問www.altera.com或www.altera.com.cn，了解更詳細的信息。?

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Altera、可編程解決方案公司、程式化Altera標識、專用器件名稱和所有其他專有商標或者服務(wù)標記，除非特別聲明，均為Altera公司在美國和其他國家的商標和服務(wù)標記。所有其他產(chǎn)品或者服務(wù)名稱的所有權(quán)屬于其各自持有人。

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