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一种基于可变相位累加器的全数字锁相环
發(fā)表于：2019/8/14 下午4:08:00
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基于流水线技术的全数字锁相环设计
發(fā)表于：2019/4/13 下午3:26:00
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基于DSP Builder的带宽自适应全数字锁相环的设计
發(fā)表于：2013/1/15 下午4:33:37
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应用于倍频电路的预置可逆分频器设计
發(fā)表于：2011/8/23 上午11:43:41
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一种新型PID控制的全数字锁相环的设计与实现
發(fā)表于：2011/1/10 下午2:28:00
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基于DSP Builder的带宽自适应全数字锁相环的设计与实现
發(fā)表于：2010/10/20 下午1:48:22
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一种基于VHDL语言的全数字锁相环的实现
發(fā)表于：2009/6/25 下午3:30:08
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基于CPLD的感应加热数控系统的设计
發(fā)表于：2009/5/6 下午3:05:18
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