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一種新的嵌入式Simplified TCP/IP協(xié)議棧的研究與實(shí)現(xiàn)[嵌入式技術(shù)][其他]

設(shè)計(jì)了一種適合8位/16位微控制系統(tǒng)的嵌入式TCP/IP協(xié)議棧。新的協(xié)議棧實(shí)現(xiàn)了標(biāo)準(zhǔn)TCP/IP協(xié)議棧的主要功能,對(duì)系統(tǒng)資源要求少,為家電網(wǎng)絡(luò)化管理創(chuàng)造了條件。

發(fā)表于：7/17/2012

基于PIC16C74單片機(jī)空調(diào)室內(nèi)機(jī)軟件的實(shí)現(xiàn)[嵌入式技術(shù)][其他]

在介紹空調(diào)室內(nèi)機(jī)控制器功能的基礎(chǔ)上，從軟件的規(guī)劃著手，詳細(xì)介紹了室內(nèi)機(jī)軟件的總體設(shè)計(jì)過程、詳細(xì)設(shè)計(jì)過程以及編碼的實(shí)現(xiàn)，并在此基礎(chǔ)上重點(diǎn)給出了空調(diào)室內(nèi)機(jī)運(yùn)行模式的特點(diǎn)和結(jié)合這些特點(diǎn)如何用MPLAB集成開發(fā)環(huán)境去實(shí)現(xiàn)各運(yùn)行模式。

發(fā)表于：7/17/2012

使用 CPLD 實(shí)現(xiàn) QWERTY 鍵盤[可編程邏輯][其他]

使用 Xilinx CPLD，可將傳統(tǒng)的手機(jī) DTMF 鍵盤擴(kuò)展為 QWERTY 鍵盤。除了減少處理器對(duì) GPIO 的數(shù)量要求外，CPLD 還可以承擔(dān)處理器的某些功能，如：對(duì)行進(jìn)行掃描并對(duì)列進(jìn)行監(jiān)控以檢測(cè)狀態(tài)變化。當(dāng)用戶按鍵時(shí)，CPLD 會(huì)停止掃描，并立即生成一個(gè)編碼字，然后發(fā)送給處理器，告訴處理器哪個(gè)鍵按下了。因?yàn)槭褂昧司幋a字來告知處理器按下了哪個(gè)按鍵，對(duì)處理器的 I/O 需求得以減輕。

發(fā)表于：7/17/2012

基于Winodws CE的嵌入式網(wǎng)絡(luò)監(jiān)控系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)[嵌入式技術(shù)][其他]

該系統(tǒng)以Windows CE嵌入式操作系統(tǒng)為核心，利用串口及CAN總線與底層I/O節(jié)點(diǎn)進(jìn)行數(shù)據(jù)通信，并實(shí)現(xiàn)對(duì)下層設(shè)備的實(shí)時(shí)監(jiān)控。主控制臺(tái)可以直接聯(lián)入Internet網(wǎng)，應(yīng)用嵌入式系統(tǒng)中的網(wǎng)絡(luò)功能，將系統(tǒng)故障信息向維修中心的服務(wù)器傳遞，實(shí)現(xiàn)遠(yuǎn)程診斷。

發(fā)表于：7/17/2012

采用MPC5200實(shí)現(xiàn)高速視頻探測(cè)的車內(nèi)應(yīng)用[嵌入式技術(shù)][其他]

在FPU的幫助下，MPC5200處理能力可為大多數(shù)視頻探測(cè)算法提供足夠的支持。集成的PCI接口則為CMOS圖像傳感器提供標(biāo)準(zhǔn)化的高速接口，CMOS圖像傳感器能以每秒80至100幀的速率將圖像數(shù)據(jù)傳輸?shù)組PC5200中，具體視PCI時(shí)鐘和照片的分辨率而定。

發(fā)表于：7/17/2012

基于ADSP-TS101的數(shù)字式雷達(dá)信號(hào)處理器[嵌入式技術(shù)][其他]

本文討論的是由高速DSP芯片ADSP—TS101構(gòu)成的數(shù)字式雷達(dá)信號(hào)處理器。本系統(tǒng)在設(shè)計(jì)時(shí)比較好地發(fā)揮了高速DSP芯片ADSP-TS101的良好性能；合理地解決了高速數(shù)據(jù)率的問題；充分地利用了芯片內(nèi)部資源；降低了系統(tǒng)設(shè)備的復(fù)雜性，又保證了系統(tǒng)性能。

發(fā)表于：7/17/2012

利用ARM通過I2C總線實(shí)現(xiàn)TMS320VC5509A引導(dǎo)裝載設(shè)計(jì)[嵌入式技術(shù)][其他]

本文提出的引導(dǎo)方式已經(jīng)成功地應(yīng)用于一款低功耗、小型戶數(shù)傳設(shè)備當(dāng)中，免去了對(duì)外部存儲(chǔ)器的編程，特別有利于設(shè)備的升級(jí)和維護(hù)。

發(fā)表于：7/17/2012

一種基于單片機(jī)的函數(shù)發(fā)生器的設(shè)計(jì)實(shí)現(xiàn)[嵌入式技術(shù)][其他]

在自動(dòng)控制系統(tǒng)設(shè)計(jì)及調(diào)試過程中，不同頻率的正弦波、三角波和方波常作為信號(hào)源，應(yīng)用十分方便。過去常由分立元件及集成運(yùn)放構(gòu)成振蕩器，后來出現(xiàn)的ICL8038其最高頻率僅能達(dá)到100kHz。而MAX038芯片性能更好，最高頻率可達(dá)20MHz，且三種波形由同一端輸出。單片機(jī)控制品質(zhì)卓越，基于單片機(jī)的函數(shù)發(fā)生器運(yùn)行可靠，操作方便。

發(fā)表于：7/17/2012

基于μC/OS-Ⅱ的嵌入式系統(tǒng)以太網(wǎng)通信功能的實(shí)現(xiàn)[嵌入式技術(shù)][其他]

u C/OS-Ⅱ是一個(gè)源碼開放的搶占式實(shí)時(shí)操作系統(tǒng)。它內(nèi)核短小精悍、可裁減、執(zhí)行時(shí)間確定。系統(tǒng)大部分代碼采用C語言編寫，與硬件有關(guān)的部分都集中在兩個(gè)文件中，給出了規(guī)范的接口說明，移植相當(dāng)方便，可應(yīng)用于目前大多數(shù)型號(hào)的8位、16位、32位CPU。

發(fā)表于：7/17/2012

基于Xilinx Spartan-3A DSP的安全視頻分析[可編程邏輯][其他]

作者：CsabaRekeczky,Eutecus公司聯(lián)合首席技術(shù)官兼副總裁，rcsaba@eutecus.comJoeMallett，賽靈思公司高級(jí)產(chǎn)品線經(jīng)理，jmallett@xilinx

發(fā)表于：7/17/2012

基于PXI總線接口的高速數(shù)字化儀模塊[可編程邏輯][其他]

本文所設(shè)計(jì)的數(shù)字化儀是基于高性能FPGA芯片實(shí)現(xiàn)的，F(xiàn)PGA承擔(dān)了絕大部分的控制和數(shù)據(jù)處理任務(wù)，是本設(shè)計(jì)的核心器件。對(duì)FPGA進(jìn)行模塊化設(shè)計(jì)，是大型系統(tǒng)設(shè)計(jì)的常用方法。合理分割功能模塊，能加快FPGA的開發(fā)，也有利于代碼的移植和重復(fù)利用。在設(shè)計(jì)時(shí)將FPGA分成高速A／D接口模塊、數(shù)據(jù)降速模塊、調(diào)理通路控制模塊、存儲(chǔ)接口模塊、PXI接口控制模塊等主要功能模塊設(shè)計(jì)。

發(fā)表于：7/17/2012

基于FPGA和PCI的高精度測(cè)速板卡的設(shè)計(jì)與實(shí)現(xiàn)[可編程邏輯][其他]

經(jīng)典的碼盤數(shù)字測(cè)速方法有M 法、T 法、M/ T 法，但都有一定的不足。為了克服原有方法的不足，設(shè)計(jì)并實(shí)現(xiàn)了一種在較大速度范圍都有良好精度和良好快速性的測(cè)速方法。電路采用FPGA 實(shí)現(xiàn)，測(cè)速得到的數(shù)據(jù)通過PCI 總線從設(shè)備控制器實(shí)現(xiàn)與控制計(jì)算機(jī)通信。從而根據(jù)實(shí)際傳輸?shù)男枰?，?jiǎn)化了PCI 從設(shè)備控制器，實(shí)現(xiàn)了PCI 總線I/ O 普通讀與猝發(fā)讀數(shù)據(jù)的功能。

發(fā)表于：7/17/2012

基于Java平臺(tái)的可編程嵌入式系統(tǒng)設(shè)計(jì)[可編程邏輯][其他]

傳統(tǒng)的嵌入式產(chǎn)品只能實(shí)現(xiàn)某種特定的功能，不能滿足用戶可變的豐富多彩的應(yīng)用需求。為解決這個(gè)問題，本文設(shè)計(jì)并實(shí)現(xiàn)了一種使用Java作為軟件平臺(tái)的基于FPGA的可編程嵌入式系統(tǒng)，以實(shí)現(xiàn)系統(tǒng)對(duì)多種本地應(yīng)用和網(wǎng)絡(luò)的支持。

發(fā)表于：7/17/2012

基于FPGA和SMT387的SAR數(shù)據(jù)采集與存儲(chǔ)系統(tǒng)[可編程邏輯][其他]

設(shè)計(jì)并實(shí)現(xiàn)了一種應(yīng)用于SAR，基于SATA硬盤的高速數(shù)據(jù)采集和存儲(chǔ)系統(tǒng)。采用FPGA實(shí)現(xiàn)系統(tǒng)工作時(shí)序控制，DSP功能模塊完成信號(hào)的處理和對(duì)硬盤的操作。該系統(tǒng)能夠?qū)崿F(xiàn)脫機(jī)，長(zhǎng)時(shí)間，高速大容量的數(shù)據(jù)存儲(chǔ)。

發(fā)表于：7/17/2012

基于FPGA的CCD相機(jī)時(shí)序發(fā)生器[可編程邏輯][其他]

這種設(shè)計(jì)方案簡(jiǎn)單、可靠、實(shí)用。在綜合比較各種硬件實(shí)現(xiàn)電路的優(yōu) 缺點(diǎn)后，選用現(xiàn)場(chǎng)可編程邏輯門陣列（FPGA）作為硬件設(shè)計(jì)平臺(tái)，使用VHDL 語言對(duì)驅(qū)動(dòng)電路方案進(jìn)行了硬件描述，采用EDA 軟件對(duì)所設(shè)計(jì)的時(shí)序發(fā)生器成功地進(jìn)行了功能仿真。最后針對(duì)XILINX公司的可編程邏輯器件XC2VP20-FF1152進(jìn)行了適配和硬件電路調(diào)試，進(jìn)而實(shí)現(xiàn)了對(duì)整個(gè)科學(xué)級(jí)CCD 相機(jī)的控制。

發(fā)表于：7/17/2012