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銀湖資本完成對(duì)Altera的51%股權(quán)收購(gòu)

銀湖資本完成對(duì)Altera的51%股權(quán)收購(gòu)

北京時(shí)間9月15日晚間，全球 FPGA 創(chuàng)新技術(shù)領(lǐng)導(dǎo)者 Altera 宣布，全球技術(shù)投資巨頭銀湖資本（Silver Lake）已完成對(duì) Altera 51% 股權(quán)的收購(gòu)，該股權(quán)原由英特爾公司持有。同時(shí)，英特爾將保留 Altera 49% 的股權(quán)，此舉也彰顯了雙方對(duì) Altera 未來(lái)良好發(fā)展充滿信心。

基于FPGA的GMSK調(diào)制器設(shè)計(jì)

本文實(shí)現(xiàn)了一種基于CMX589A和FPGA的GMSK調(diào)制器。系統(tǒng)采用了主從式的結(jié)構(gòu)，主控機(jī)由單片機(jī)實(shí)現(xiàn)對(duì)于GMSK調(diào)制器系統(tǒng)參數(shù)的控制，CMX589A模塊完成基帶信號(hào)高斯濾波，F(xiàn)M調(diào)制器采用直接數(shù)字頻率合成技術(shù)(DDS)在FPGA硬件平臺(tái)上實(shí)現(xiàn)、系統(tǒng)最高輸出頻率為25 MHz。同時(shí)系統(tǒng)具有很寬的基帶信號(hào)數(shù)據(jù)和調(diào)制參數(shù)靈活可控等特點(diǎn)，并且克服了正交調(diào)制方案中嚴(yán)格正交載波產(chǎn)生困難的缺陷。測(cè)試結(jié)果表明，已調(diào)信號(hào)包絡(luò)恒定，頻譜滿足設(shè)計(jì)要求，適用于CDPD，無(wú)中心站等多種通信系統(tǒng)。

發(fā)表于：2/14/2012

SoPC+GPS/GSM實(shí)現(xiàn)汽車(chē)狀態(tài)監(jiān)控系統(tǒng)

基于SoPC的汽車(chē)安全監(jiān)控系統(tǒng)采用Altera公司最新的SoPC(可編程片上系統(tǒng))解決方案——Nios處理器軟核為核心，配合GPS和GSM系統(tǒng)，對(duì)汽車(chē)的停放和運(yùn)行狀態(tài)進(jìn)行監(jiān)控。

發(fā)表于：2/14/2012

電耦合型人體通信收發(fā)器的設(shè)計(jì)與實(shí)現(xiàn)

針對(duì)電流耦合型人體通信的特點(diǎn)，以FPGA為平臺(tái)，分別設(shè)計(jì)出基于DDS的2CPFSK調(diào)制器、全數(shù)字鎖相環(huán)位同步電路和信號(hào)解調(diào)器。此外，外圍電路實(shí)現(xiàn)了發(fā)送端低通濾波、信號(hào)保持和接收端前處理等功能。最后對(duì)電流耦合型人體通信收發(fā)器的進(jìn)行人體實(shí)驗(yàn)。實(shí)驗(yàn)結(jié)果表明收發(fā)器滿足設(shè)計(jì)要求，可以實(shí)現(xiàn)數(shù)字基帶信號(hào)在人體內(nèi)的傳輸。

發(fā)表于：2/13/2012

Altium與Altera合作發(fā)布全新在線元件資源和軟件支持

下一代電子設(shè)計(jì)軟件與服務(wù)開(kāi)發(fā)商Altium公司近日宣布為Altera的Stratix® IV FPGA和MAX® V CPLD器件產(chǎn)品系列的板級(jí)元件提供全新的器件和升級(jí)，通過(guò)Altium的生態(tài)系統(tǒng)AltiumLive即可在線獲得。與此同時(shí)，在Altium的一體化電子設(shè)計(jì)系統(tǒng)Altium Designer 10最近一次升級(jí)中，也同期發(fā)布了對(duì)于Altera Stratix IV FPGA和MAX V CPLD的器件支持。

發(fā)表于：2/13/2012

基于CPLD的步進(jìn)電機(jī)驅(qū)動(dòng)模塊設(shè)計(jì)

數(shù)控技術(shù)是以數(shù)字量編程實(shí)現(xiàn)控制機(jī)械或其他設(shè)備自動(dòng)工作的技術(shù)，數(shù)控機(jī)床就是采用了數(shù)控技術(shù)的機(jī)床，或者說(shuō)裝備了數(shù)控系統(tǒng)的機(jī)床。機(jī)床數(shù)控系統(tǒng)主要由幾個(gè)部分組成：零件加工程序的輸入、數(shù)據(jù)處理、插補(bǔ)計(jì)算和運(yùn)動(dòng)機(jī)構(gòu)的控制。本文主要介紹最后一個(gè)部分運(yùn)動(dòng)機(jī)構(gòu)的控制，即如何控制電機(jī)的動(dòng)作?？蛇x的電機(jī)有很多種，在這里我們選擇步進(jìn)電機(jī)。

發(fā)表于：2/13/2012

基于單片機(jī)及FPGA的程控濾波器設(shè)計(jì)與實(shí)現(xiàn)

本系統(tǒng)放大器增益范圍10～60dB，通頻帶1～200kHz，增益誤差小于1％。濾波器截止頻率范圍1～30kHz，誤差小于1．5％。橢圓濾波器截止頻率誤差為0，在150kHz處幅度幾乎衰減到0。誤差主要來(lái)源于時(shí)鐘頻率，當(dāng)截止頻率為20kHz的時(shí)候，所需最高的時(shí)鐘頻率為2MHz，不能保證很好的時(shí)鐘沿，而且時(shí)鐘頻率也不可能精確地控制，以及放大器的非線性誤差。此外，利用DAC0800和有效值檢波電路實(shí)現(xiàn)了幅頻特性測(cè)試儀，系統(tǒng)整體性能良好。整個(gè)系統(tǒng)在單片機(jī)和FPGA的有機(jī)結(jié)合、協(xié)同控制下，工作穩(wěn)定，測(cè)量精度高，人機(jī)交互靈活。

發(fā)表于：2/13/2012

WCSP 在克服各種挑戰(zhàn)的同時(shí)不斷發(fā)展

晶圓芯片級(jí)封裝 (WCSP) 去掉了許多傳統(tǒng)的封裝步驟，例如：裸片焊接、引線接合以及芯片級(jí)倒裝片 (flip chip) 連接工藝等。這種方法使半導(dǎo)體客戶加速了產(chǎn)品上市進(jìn)程。WCSP 應(yīng)用正擴(kuò)展到一些新領(lǐng)域，并逐漸出現(xiàn)基于引腳數(shù)量和器件類(lèi)型的細(xì)分市場(chǎng)。集成無(wú)源分立 RF 和存儲(chǔ)器件的 WCSP 應(yīng)用也正擴(kuò)展到邏輯 IC 和 MEMS。但是這種發(fā)展也帶來(lái)了許多挑戰(zhàn)，包括裸片尺寸和引腳數(shù)的增長(zhǎng)對(duì)板級(jí)可靠性所產(chǎn)生的影響。本文將介紹我們當(dāng)前面臨的諸多挑戰(zhàn)，以及集成化和硅過(guò)孔 (TSV) 技術(shù)等一些未來(lái)發(fā)展趨勢(shì)。

發(fā)表于：2/13/2012

基于DSP的視頻采集系統(tǒng)仿真設(shè)計(jì)

數(shù)字圖象處理技術(shù)在電子通信與信息處理領(lǐng)域得到了廣泛的應(yīng)用，設(shè)計(jì)一種功能靈活、使用方便、便于嵌入到系統(tǒng)中的視頻信號(hào)采集電路具有重要的實(shí)用意義。

發(fā)表于：2/12/2012

基于Simulink的OSEK嵌入式軟件開(kāi)發(fā)方法

目前越來(lái)越多的汽車(chē)電子系統(tǒng)的開(kāi)發(fā)借助Matlab／Simulink，并且其已變成標(biāo)準(zhǔn)的開(kāi)發(fā)工具。本文提出的軟件開(kāi)發(fā)方法基于Sireulink環(huán)境和OSEK OS規(guī)范。在Simulink環(huán)境下開(kāi)發(fā)的算法可以結(jié)合OSEK RTOS(本文為修改過(guò)的μC／OS-II)直接應(yīng)用到目標(biāo)硬件上。該方法已通過(guò)實(shí)例進(jìn)行了驗(yàn)證，與傳統(tǒng)方法比較極大地縮短了開(kāi)發(fā)時(shí)間。

發(fā)表于：2/12/2012

Cypress CY8CKIT-001 PSoC3系列開(kāi)發(fā)方案

Cypress公司的CY8CKIT-001PSoC3系列開(kāi)發(fā)套件(DVK)是通用的開(kāi)發(fā)平臺(tái),用來(lái)評(píng)估采用PSoC1,PSoC3或PSoC5架構(gòu)的不同解決方案和原型,可以實(shí)現(xiàn)硬件,固件和軟件開(kāi)發(fā).開(kāi)發(fā)套件(DVK)還包括了PSoC1,PSoC3或PSoC5系列處理器模塊.

發(fā)表于：2/12/2012