用Blackfin 处理器实现删余速率为1:4的维特比解码器
所屬分類：技术论文
上傳者：serena
文檔大小：193 K
標簽： DSP
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文檔介紹：另外，本文将介绍一个约束长度为5的删余速率为1:4的维特比解码器的实现案例，并假设读者熟悉维特比算法的一些基本原理。
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