PCI-Express总线传输效率提升的技术分析
2022年电子技术应用第5期
潘金龙，李德建，王于波，冯 曦，董长征，冯文楠
北京智芯微电子科技有限公司，北京100192
摘要： 高速差分PCI-Express总线的应用场景越来越广阔，为了提高总线上数据传输的效率，从PCI-Express的总线结构、带宽开销点、系统参数配置进行说明，并通过对不同长度的报文在读、写传输的背景下进行理论分析与计算，得到了提升总线传输效率的合理配置，实现了PCI-Express总线传输效率的显著提升。
中圖分類號： TP336
文獻標識碼： A
DOI：10.16157/j.issn.0258-7998.211844
中文引用格式： 潘金龍，李德建，王于波，等. PCI-Express總線傳輸效率提升的技術(shù)分析[J].電子技術(shù)應(yīng)用，2022，48(5)：79-83.
英文引用格式： Pan Jinlong，Li Dejian，Wang Yubo，et al. Technical analysis of improving the transmission efficiency of PCI-Express bus[J]. Application of Electronic Technique，2022，48(5)：79-83.
文獻標識碼： A
DOI：10.16157/j.issn.0258-7998.211844
中文引用格式： 潘金龍，李德建，王于波，等. PCI-Express總線傳輸效率提升的技術(shù)分析[J].電子技術(shù)應(yīng)用，2022，48(5)：79-83.
英文引用格式： Pan Jinlong，Li Dejian，Wang Yubo，et al. Technical analysis of improving the transmission efficiency of PCI-Express bus[J]. Application of Electronic Technique，2022，48(5)：79-83.
Technical analysis of improving the transmission efficiency of PCI-Express bus
Pan Jinlong，Li Dejian，Wang Yubo，Feng Xi，Dong Changzheng，Feng Wennan
Beijing Smartchip Microelectronics Technology Co.，Ltd.，Beijing 100192，China
Abstract： The application scenarios of high-speed differential PCI Express bus are becoming wider and wider. In order to improve the efficiency of data transmission on the bus, this paper explains the bus structure, bandwidth overhead point and system parameter configuration of PCI-Express, and obtains the reasonable configuration to improve the bus transmission efficiency through the theoretical analysis and calculation of messages of different lengths under the background of read and write transmission. The PCI-Express bus transmission efficiency is significantly improved.
Key words : PCI-Express；transmission efficiency；bandwidth overhead；system parameter
0 引言
隨著現(xiàn)代處理器技術(shù)的飛速發(fā)展，使用高速差分總線替代并行總線的應(yīng)用場景越來越多。與單端信號相比，高速差分信號可以使用更高的時鐘頻率，使用更少的信號線，完成之前需要很多單端并行數(shù)據(jù)信號才能達到的總線帶寬[1]。如何高效地利用總線帶寬，通過何種配置達到最優(yōu)應(yīng)用，給設(shè)計者帶來了挑戰(zhàn)。
1 總線概述
PCI-Express(Peripheral Component Interconnect Express)是一種高速串行計算機擴展總線標準，簡稱PCIe。PCIe屬于高速串行點對點雙通道高帶寬傳輸，互聯(lián)設(shè)備之間獨立傳輸，主要有主動電源管理、錯誤報告、端對端的可靠性傳輸、熱插拔以及服務(wù)質(zhì)量等功能。PCIe是一種分層協(xié)議，由傳輸層、數(shù)據(jù)鏈路層和物理層組成[1-3]，層級結(jié)構(gòu)如圖1所示[4-5]。PCIe A設(shè)備與B設(shè)備之間通過發(fā)送端與接收端進行互聯(lián)。
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作者信息：
潘金龍，李德建，王于波，馮 曦，董長征，馮文楠
(北京智芯微電子科技有限公司，北京100192)
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