亿门级层次化物理设计时钟树的研究
所屬分類：技术论文
上傳者：wwei
文檔大小：3377 K
標(biāo)簽： 亿门级 VLSI 层次化物理设计
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文檔介紹：传统的展平式物理设计已不能满足VLSI的设计需求，层次化物理设计已成为VLSI设计的主流方法。在VLSI层次化物理设计过程中，顶层寄存器和子模块内寄存器的时钟树偏差对整个芯片时序收敛有很大的影响。针对亿门级层次化顶层物理设计时钟树无法读取到子模块中的时钟树延时，导致最终顶层寄存器和子模块内寄存器时钟偏差过大的问题，提出了在顶层时钟树综合阶段设置子模块实际时钟延迟的方法，有效地减小顶层寄存器和子模块内寄存器的时钟偏差，为后续的时序优化提供了有效保障。
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