| 基于双核Nios II系统的数字预失真器设计 | |
| 所屬分類:参考设计 | |
| 上傳者:aet | |
| 文檔大?。?span>395 K | |
| 標(biāo)簽: FPGA | |
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| 文檔介紹:设计了一种基于双核Nios II系统的数字预失真器(DPD)。在FPGA中构建多查找表结构,实现了基于记忆多项式模型的DPD;采用双核处理器完成并行RLS算法处理,保证了DPD模型参数提取过程的执行效率。实验结果证明,该系统能够对功放的非线性进行较好补偿。 | |
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